基于GPS实现电力系统高精度同步时钟

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成果类型：

期刊论文

作者：

蒋陆萍;曾祥君;李泽文;彭安安

通讯作者：

Jiang, L.(jlp736200@163.com)

作者机构：

[蒋陆萍; Zeng, Xiangjun; 李泽文] School of Electrical and Information Engineering, Changsha University of Science and Technology, Changsha 410076, Hunan Province, China

[彭安安] School of Electrical Engineering, Nanhua University, Hengyang 421001, Hunan Province, China

通讯机构：

School of Electrical and Information Engineering, Changsha University of Science and Technology, China

语种：

中文

关键词：

全球定位系统;晶振;时钟;复杂可编程逻辑器件;秒脉冲

关键词(英文)：

Clock;Complex programmable logic device (CPLD);Crystal oscillator;Global positioning system (GPS);One pulse per second

期刊：

电网技术

ISSN：

1000-3673

年：

2011

卷：

期：

页码：

201-206

DOI：

10.13335/j.1000-3673.pst.2011.02.036

基金类别：

湖南省教育厅科研项目（09C079）；

机构署名：

本校为其他机构

院系归属：

电气工程学院

摘要：

根据全球定位系统(global positioning system, GPS)秒时钟的随机误差和高精度晶振的累计误差互补的特点, 利用数字锁相原理, 通过测量GPS秒时钟与晶振秒时钟间的相位差来控制晶振秒时钟的分频系数, 实时消除晶振秒时钟的累计误差, 从而产生高精度秒时钟, 并利用复杂可编程逻辑器件(complex programmable logic device, CPLD)设计了高精度同步时钟系统. GPS信号接收正常时, CPLD根据数字锁相原理产生高精度同步时钟; GPS信号接收不正常时, CPU调取存储的分频系数控制CPLD产生高精度时钟. 仿真分析和实验结果表明该时钟系统具有很高的时间准确度和稳定性

摘要(英文)：

In view of the complementarities between the random error of one pulse per second （1PPS） in global positioning system （GPS） and accumulated error of high-precision crystal oscillator, based on the principle of digital phase-locked loop （DPLL） it is proposed to control frequency dividing coefficient of the crystal oscillator second clock by measuring the phase difference between 1PPS of GPS and the crystal oscillator second clock to eliminate the accumulated error of crystal oscillator in real-time mode, thus high-precision 1PPS can be att...

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